Embedded Files
21 de mayo de 2021
En este capítulo veremos cómo modelar autómatas finitos o finite state machines.
Las máquinas de estado finito, son uno de los circuitos digitales más útiles a la hora de implementar circuitos secuenciales, donde la salida depende del valor de la entrada y el estado anterior.
Publicado el 1 de agosto de 2021Actualizado el 23 de enero de 2022
En el siguiente tutorial veremos cómo hacer un ascensor de tres plantas controlado con la Alhambra FPGA.
Para que no quede muy extenso lo he dividido en dos partes partes:
En la primera parte se explica el montaje mecánico y el esquema eléctrico de conexión.
En la segunda parte veremos cómo controlar el ascensor programando la Alhambra FPGA como máquina de estado finito.
6 de marzo de 2022
En el siguiente tutorial veremos las mejoras que he añadido al proyecto del ascensor, tales como un sistema de arranque y parada suaves mediante optoswitches y motor de dos velocidades controlado con PWM, un display de 7 segmentos para indicar el piso en que se encuentra el ascensor, una puerta automática accionada con un servo y un sensor óptico de seguridad de puerta abierta
12 de noviembre de 2021
En este capítulo veremos cómo generar tonos de distintas frecuencias con la Alhambra FPGA y además aprenderemos algo muy útil e importante en Verilog, interconectar módulos.
27 de marzo de 2022
En este capítulo veremos algunos conceptos básicos para controlar motores paso a paso con la Alhambra FPGA .
13 de abril de 2022
En el siguiente tutorial diseñaremos un control manual mediante joystick + Alhambra FPGA, de un brazo robot accionado con motores paso a paso.
10 de diciembre de 2022
En el siguiente tutorial veremos cómo hacer una máquina arcade del juego de la grúa.
Este proyecto ha sido publicado en otras ocasiones, así que para hacerlo de manera diferente lo he rediseñado por completo, introduciendo un poco de sobreingeniería; motores paso a paso en todos los ejes, finales de carrera, nuevo diseño de la garra...todo controlado con la Alhambra FPGA y programado en Verilog.
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